独特的RTL调整环境（tuning environment）减少实体设计重复（Iterations）

重点摘要：

RTL Architect是业界第一个以快速多维预测发动机（multi-dimensional prediction engine）为基础，具备实体察觉（physically aware）RTL分析、优化和签核的系统，可实现绝佳的RTL移交 （handoff）。 统一的融合（Fusion）数据模型提供了前所未有的容量和可扩展性（scalability），可实现全芯片（full-chip）层阶（hierarchical ）RTL设计流程。 这项新产品利用了新思科技世界级的实作和金级签核解决方案，可提供与建构相关（correlate-by-construction）的结果。 新思科技与安谋国际目前正进行RTL Architect的相关合作，以加速新一代核心（cores）的开发。

新思科技近日宣布RTL Architect™即刻上市，该创新产品可有效加速RTL设计收敛（design closure），促进整体芯片设计流程的向左推移（shift-left）。新思科技的RTL Architect是业界第一个具备实体察觉（physically aware）的RTL设计系统，能缩短一半的SoC实作周期，并实现卓越的结果品质（quality-of-results，QoR）。

 

为了提升功耗、效能和面积（PPA）的表现，以符合人工智能和汽车应用等新垂直市场的要求，快速探索特定领域的RTL架构已成为RTL团队经常面对的挑战。由于下游实作的准确度低，因此用来评估RTL品质的现有单点工具（point tool）受到严重限制。这些早期设计周期的不准确性导致下游实作工具得进行弥补措施，通常得回头修正RTL才能达到PPA的目标。为了因应这些挑战，RTL Architect采用新思科技“融合设计平台”（Fusion Design Platform）实作环境的快速多目标预测发动机，准确预测下游实作的PPA。RTL Architect能让RTL设计人员确切地找出源代码中的瓶颈，以提高RTL品质。

 

瑞萨电子（Renesas）EDA共享研发暨电子数码设计技术处处长Hideyuki Okabe表示：“瑞萨正在设计一种复杂而雪铁龙的车用SoC，而这需要架构调整（architecture tuning）以实现最高的OoR，以便在目标市场中脱颖而出。新思科技RTL Architect能让我们在RTL阶段快速探索、验证各式架构，并找出最佳方案，让我们不必担心后期发生突发状况。”

 

安谋国际（Arm）中央工程事业群CPU工程副总裁Jeff Kehl表示：“我们与新思科技就RTL Architect产品的合作可有效促进新一代ARM处理器核心RTL的开发周期。我们的雪铁龙核心开发设计方法中的RTL Architect技术，能让安谋国际开发更好的CPU，让双方共同的客户针对创新市场，达成对于功耗和效能的要求。”

 

RTL Architect系统是创建在统一的数据模型上，该模型提供了数十亿的闸容量（gate capacity）和全面性层阶设计（hierarchical design）的能力，能应付雪铁龙制程节点中不断增加的设计和区块尺寸（block sizes）。该产品直接利用新思科技世界级的实作与金级签核解决方案，能在设计周期初期即提供准确的结果，且该结果是与建构相关的（correlate-by-construction）。

 

RTL Architect使用快速的多维实作发动机，让RTL设计人员可以预测RTL变更对功耗、效能、面积与壅塞（congestion）的影响。该产品集成了新思科技PrimePower的金级签核功耗分析发动机，可进行准确的RTL功耗预估和优化，实现节能设计。RTL Architect提供了统一的工作流程环境，可针对重要PPA品质指标进行简化且易于使用的分析。另外，也为闸层级（gate-level）的PrimePower既有用户提供了PrimePower RTL功耗预估，从而透过一致的RTL进行功耗分析流程的签核。

 

新思科技设计事业群设计实作资深副总裁Shankar Krishnamoorthy表示：“随著我们迈向更小的技术节点，要达到最佳设计PPA，实现快速RTL调整重复（tuning iteration）和快速架构探索就变得非常关键。在设计周期初期解决这些挑战，并设计出高品质的RTL，对实现最佳OoR以及最快速的结果效率（time to result）来说相当重要。RTL Architect旨在解决芯片设计界日益增加的需求，协助设计人员移交绝佳的RTL，以达到设计收敛与最佳的PPA。”

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